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每天一小时 用搭积木的方法从零学习FPGA(DDR SDRAM)

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发表于 2017-7-25 09:54 | 显示全部楼层 |阅读模式

上一节中,我们学习了SPI接口。UART、I2C、SPI等接口在时序图上有共通的地方,仔细研究会一个,那么学习其他接口也可以做到犹如探囊取物。

学习基础的通信接口后,我们需要考虑数据的存储问题。Block RAM作为FPGA内部的存储资源,使用方便,然而资源量并不大,在存储大量数据的时候显得力不从心。这时候就需要外援DDR的帮助。
DDR,严格的来说应该叫DDR SRAM。我们最常听到的DDR是内存条,仔细看就会发现,每个内存条上都有很多DDR SRAM芯片。DDR是Double Data Rate的缩写,即双倍采样率。如果DDR和SDR(单边缘采样)采样时钟频率一样,则DDR的数据带宽比SDR大一倍。从DDR到DDR2、DDR3、DDR4,数据的延迟在不断的变小,传输速率也在不断的加强。电脑上的内存条,是通过金手指插到电脑主板的插槽上。而FPGA使用DDR,却是将DDR的引脚和FPGA的管脚进行相连。DDR的引脚控制非常复杂,还涉及到了时序问题。为了简化DDR的使用,Xilinx推出了DDR控制器MIG IP核,在实际使用DDR的时候,我们通过MIG核,就可以轻松控制DDR的读写。

6.jpg


视频详细讲解了MIG核的使用方法,并且通过一个简单的DDR2读写例程,讲解了板卡上DDR2的调试。

不同版本的Vivado打开工程可能会提示升级。直接升级就好。

我们分享出一些常用Vivado版本的百度网盘链接: http://pan.baidu.com/s/1qXL9eK8 密码: ksxr

更多的版本请去官方网站上下载:https://www.xilinx.com/support/download.html

话不多说,跟着视频一起进行学习吧。


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论坛元老

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发表于 2017-7-25 14:52 | 显示全部楼层
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