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Timing Analysis in Xilinx ISE

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发表于 2010-5-21 10:00 | 显示全部楼层 |阅读模式
如果进行FPGA设计的时候时钟要求很高的话,Timing Analysis 这一步是必不可少了!
一个英文的入门教程
timinganalysis.pdf (374.91 KB, 下载次数: 218)
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发表于 2010-5-28 09:34 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

下来看看
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发表于 2010-5-30 22:12 | 显示全部楼层

回复:Timing Analysis in Xilinx ISE

回复第 1 楼 KiKi于2010-05-21 02:00:46发表:
 
好资料!!!
如果进行FPGA设计的时候时钟要求很高的话,Timing Analysis 这一步是必不可少了!
一个英文的入门教程

-----------------------------------------------
因分享而快乐
 
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发表于 2010-6-5 15:42 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

FPGA最难的就是Timing了谢谢分享!
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发表于 2010-6-7 22:01 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

thx
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发表于 2010-6-11 14:11 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

谢谢!
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发表于 2010-6-12 15:00 | 显示全部楼层

回复:Timing Analysis in Xilinx ISE

看看,学习了。谢谢
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发表于 2010-6-12 15:02 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

楼主,也太短了吧
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发表于 2010-9-2 23:24 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

谢谢分享
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发表于 2011-1-12 21:47 | 显示全部楼层

RE:Timing Analysis in Xilinx ISE

xuexixuexi
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